Empresa Swadeza, fundada em Bihar, desenvolve tecnologias avançadas para semicondutores
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Empresa Swadeza, fundada em Bihar, desenvolve tecnologias avançadas para semicondutores

A questão de como pode ser concebido o conceito de 'Made in India', se tecnologias de importância global são criadas em regiões raramente associadas a tecnologias profundas, levou à criação da Swadeza. Hoje, a Swadeza está a desenvolver-se a partir de Bihar, com ambições que vão muito além da sua geografia. Isso também reflete uma mudança mais ampla na paisagem tecnológica da Índia, relacionada com a origem das empresas tecnológicas da próxima geração do país e quem as irá criar.

A fundadora Shweta Suman percorreu um caminho não linear: estudou no Omã, obteve formação em engenharia no BIT Mesra, regressou ao Omã e, depois do casamento, mudou-se de volta para Bihar. Em vez de procurar oportunidades noutros locais, ela decidiu construir a empresa exatamente aqui.

Esta escolha é significativa no contexto do estado. Bihar é frequentemente discutido em termos de migração, quando talentos e oportunidades deixam a região. O caminho de Suman vai na direção oposta: regresso, criação de uma empresa de tecnologia, integração no ecossistema de startups da Índia e, finalmente, apresentação da Swadeza numa das conferências industriais de semicondutores mais proeminentes do país.

A Swadeza opera nas áreas de tecnologias de semicondutores, consultoria e desenvolvimento de TI, bem como marketing digital 360 graus. Os seus trabalhos em tecnologias profundas estão cada vez mais focados no design de semicondutores orientado para inteligência artificial. No que diz respeito a software, a empresa cria plataformas para estruturas governamentais e públicas. A empresa posiciona-se como uma empresa feminina, afirmando que os seus engenheiros têm uma média de 11 anos de experiência em semicondutores fabless, plataformas de consumo e implementações governamentais.

Além disso, a Swadeza desenvolveu um sistema automatizado de verificação baseado em IA para contratação pública no Governo de Bihar, que, segundo a empresa, reduziu os prazos de processamento de vários meses para várias semanas. Antes que o chip seja enviado para produção, os engenheiros devem provar que o design funciona exatamente de acordo com o projeto. Esta verificação é uma das etapas mais trabalhosas do desenvolvimento de chips, e os erros detetados após a fase de tape-out custam caro.

O argumento da Swadeza é que os assistentes universais baseados em IA têm dificuldades em operar nesta escala. À medida que o design cresce, o pedido do assistente é preenchido com fragmentos não relacionados e contraditórios, o que leva a uma diminuição da qualidade da resposta. Em vez disso, a sua plataforma de semicondutores FORGE mantém o chip num mapa citado, transmite ao modelo de linguagem apenas a informação relevante para essa questão e transforma o conhecimento obtido em modelos determinísticos, de modo que cada execução deve terminar mais rápido e custar menos do que a anterior.

FORGE foi concebida para implementar fluxos de trabalho baseados em IA ao longo de todo o ciclo de vida do chip: desde a verificação e design físico até à validação pós-silício e células padrão. O sistema DV-FORGE trata da verificação; ele lê o manual de referência do chip para um mapa e gera um plano de verificação, um modelo de cobertura e um ambiente de teste UVM com base nele. A empresa relata que o DV-FORGE foi usado para SoC classe OpenTitan, concluindo com sucesso a verificação do chip root-of-trust OpenTitan Earlgrey em 30 dias e encontrando sete erros em aproximadamente 40 blocos IP e 2581 registos. Sua variante derivada, Darjeeling, foi verificada em 21 dias, sendo a maior parte do tempo gasta em testes de regressão. A Swadeza também afirma usar 80% menos tokens do que um assistente baseado em IA e aplicou este pipeline aos manuais de referência da NXP, STMicroelectronics, Renesas e Infineon.

O PD-FORGE é desenvolvido para fechar o design físico, permitindo rastrear violações durante o sign-off até à fase que as causou. Ele liga relatórios de todas as fases, execuções e ferramentas com as mesmas redes, cobrindo 26 backends da Synopsys, Cadence, Siemens e fontes abertas, e atualmente está em testes fechados antes de ser lançado em produção no quarto trimestre de 2026. O PS-FORGE, destinado à validação e depuração pós-silício, e o SC-FORGE, que visa criar células padrão comprovadamente ótimas, ainda estão em desenvolvimento.

FORGE é implantado localmente. Na indústria, onde os designs de chips são um dos ativos intelectuais mais confidenciais de uma empresa, o armazenamento de dados em ambientes de clientes elimina um obstáculo sério para a implementação de ferramentas baseadas em IA. A Swadeza afirma colaborar com professores do BIT Patna e com a Signitude, uma empresa de semicondutores fabless.

No evento SEMICON India 2026, a Swadeza apresentou as suas tecnologias de semicondutores juntamente com alguns dos nomes mais reconhecidos da indústria. Foi também a primeira demonstração pública do FORGE no estande de startups 6. A quinta edição do SEMICON India decorreu de 17 a 19 de setembro sob o tema 'Do Silício aos Sistemas: Construindo um Ecossistema'. Realizou-se dois meses após a aprovação pelo Gabinete do Semicon 2.0 — a segunda fase da missão da Índia de chips no valor de 127.500 mil milhões de rúpias.

Após isso, a Swadeza foi incluída no relatório fotográfico da Forbes India sobre o evento, no mesmo panorama visual que IBM e Tata Electronics. Para uma empresa que decidiu construir a partir de Bihar, este momento teve um significado que ia muito além da visibilidade. Colocou um produto criado em Bihar ao lado de líderes mundiais em semicondutores.

Bihar está ativamente a promover-se neste setor. O gabinete do estado aprovou a sua Política de Semicondutores de 2026 no início deste ano, procurando atrair capacidade de produção, fábricas de ecrãs e instalações de design de chips. Um Embaixador de Semicondutores de Bihar também foi criado para supervisionar a implementação. Grande parte desta política visa investimentos em produção. A Swadeza representa outro tipo de participação: ferramentas de design criadas localmente e destinadas a equipas de desenvolvimento de chips em qualquer lugar do mundo.

A visão mais ampla da Swadeza é construir a partir da Índia para o mercado mundial. Os próximos testes são evidentes: colocar o PD-FORGE em operação de produção e transformar as conversas realizadas no SEMICON em implementações locais pagas por equipas de desenvolvimento de chips. Se conseguir isso, a Swadeza será a prova de que as empresas de tecnologia profunda da Índia não precisam começar em centros tradicionais, e que a próxima onda de criadores pode surgir de lugares que o ecossistema ignorou.

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O apoio a startups no setor de projeto de microcircuitos na Índia receberá um reforço significativo com a aprovação pelo governo da União do programa Semicon 2.0, que prevê mais do dobro do apoio governamental a este segmento. O Ministro da Eletrónica e Tecnologia da Informação, Ashwini Vaishnaw, anunciou isso durante uma conversa em formato 'fireside chat' no evento SEMICON India 2026, realizado em 18 de setembro de 2026.

Seus comentários, feitos à medida que a segunda fase dos incentivos semicondutores da Índia estava sendo formada, colocam no centro das ambições do país em relação aos chips tanto os desenvolvedores tecnológicos profundos quanto a base de produção de PMEs, juntamente com grandes investimentos em fábricas.

Ashwini Vaishnaw observou que a busca da Índia por semicondutores começou há seis anos, no âmbito do Semicon 1.0. Ele enfatizou que as tentativas anteriores, que duraram quase seis décadas, falharam repetidamente devido a políticas inconsistentes e miopia.

Desta vez, o governo desenvolveu um programa baseado em um roteiro de vinte anos e uma abordagem faseada. Esta abordagem começou com divisões de montagem, teste, marcação e embalagem (ATMP) e a primeira fábrica no segmento de chip relativamente menos complexo de alta vazão — no nó de 28 a 90 nanômetros, que, segundo o ministro, representa cerca de 70% do volume mundial de chips. Vale notar que o Semicon 1.0, planejado como um projeto de seis anos, foi concluído em apenas quatro anos, o que permitiu criar a base para seu sucessor.

O Semicon 2.0, aprovado com dotações de 1,27500 crore de rúpias, baseia-se em seis áreas chave: projeto, materiais e equipamentos, fábricas adicionais, aumento da capacidade ATMP, pesquisa e desenvolvimento, e talentos. Vaishnaw indicou que o projeto de chips se mostrou o mais saturado de startups entre essas áreas.

No âmbito do Semicon 1.0, o governo eliminou, segundo Vaishnaw, o maior obstáculo para as empresas de design jovens — o alto custo de licenciamento de ferramentas de projeto eletrônico automatizado (EDA) de fornecedores como Cadence, Synopsys e Siemens. Em vez de financiar licenças individuais, o acesso a essas ferramentas foi organizado conjuntamente através do Centro de Desenvolvimento de Computação Avançada (Centre for Development of Advanced Computing). Como resultado, mais de 105 startups tornaram-se desenvolvedoras de chips, e 20 delas atraíram capital de risco, supostamente no valor de cerca de 800 crore de rúpias, de acordo com dados preliminares do governo.

Com base neste alicerce, o Semicon 2.0 visa apoiar pelo menos 200 empresas envolvidas em projeto profundo de chips, o que Vaishnaw chamou de um potencial ponto de viragem para a propriedade intelectual da Índia.

Além do projeto de chips, Vaishnaw destacou o impacto positivo do programa nos pequenos e médios fabricantes indianos. Citando um líder do setor que encontrou no evento, mas sem nomear a empresa, ele relatou que esta já começou a exportar componentes no valor de cerca de 2000 crore de rúpias da Índia, sendo que quase 90% desse ecossistema de componentes foi obtido de PMEs.

Ele acrescentou que as capacidades de fabricação de precisão, formadas em torno da montagem eletrônica, agora são usadas em vários setores, incluindo a fabricação de telefones celulares, componentes aeroespaciais para empresas como a Airbus, bem como a indústria de defesa, além dos semicondutores. Um dos líderes com quem Vaishnaw conversou observou que o conselho de administração de sua empresa o informou sobre a ausência de restrições reais a investimentos na Índia, desde que os cronogramas de trabalho sejam cumpridos, o que, em sua opinião, demonstra a confiança dos investidores no programa.

Para apoiar essa transição, o governo está implementando um sistema de treinamento multinível, começando com um curso de Nível 1 de 240 horas, destinado a preparar o estudante logo após o ensino médio com habilidades comparáveis às de um graduado de faculdade de engenharia nos níveis subsequentes. Em breve, está planeado o lançamento de um Instituto especializado em manufatura de precisão, seguido por institutos semelhantes.

Quanto ao número total de especialistas, Vaishnaw informou que a Índia estabeleceu a meta de treinar 85.000 engenheiros de projeto de semicondutores em dez anos e já treinou cerca de 70.000 nos primeiros quatro anos. Ele esclareceu que outras declarações recentes do governo indicam o alcance da meta total de 85.000 pessoas, portanto, o número exato atual pode variar dependendo da data da última atualização. Além disso, ele observou que a meta de cem mil técnicos de salas limpas no âmbito do Semicon 2.0 provavelmente exigirá um aumento devido à demanda do setor.

Um detalhe da conversa ajuda a explicar o rápido crescimento do número de startups no setor de projeto de chips na Índia. As ferramentas EDA são softwares especializados usados para layout e modelagem de chips antes de sua produção. Licenças de fornecedores como Cadence e Synopsys podem exceder o orçamento anual de uma startup em estágio inicial.

Em vez de subsidiar compras individuais, o governo considerou o acesso ao EDA como infraestrutura geral através do C-DAC, permitindo que as startups projetassem chips sem ter que arcar com esses custos sozinhas. Vaishnaw supôs que foi esse tipo de abordagem que teve maior impacto no desenvolvimento do ecossistema de projeto de chips indiano do que os subsídios diretos, pois reduziu a barreira para a própria tentativa de projetar um chip. No entanto, permanece em aberto se este modelo será mantido ao ser escalado para uma coorte quase duas vezes maior que a inicial no âmbito do Semicon 2.0.

Em conclusão, Vaishnaw mencionou que a primeira fábrica da Índia, o local Tata Electronics-PSMC em Dholera, deve entrar em operação em 2028. Ele observou que o espaço reservado para esta placa em seu gabinete ainda está vazio, servindo como um lembrete de quanto ainda precisa ser realizado das promessas do Semicon 2.0. Para as startups de projeto de chips e PMEs que apoiam este ecossistema, a próxima fase será um teste de quão bem a política baseada em infraestrutura compartilhada e treinamento faseado poderá ser escalada para além do grupo inicial.

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